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ISSN:1007-9432
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  • 0.35 μm高速真随机数芯片设计

    基金项目:
    国家自然科学基金资助项目(61475111,61775158);山西省回国留学人员科研资助项目(2017-重点2)
    分类号:
    TN402
    DOI:
    10.16355/j.cnki.issn1007-9432tyut.2019.06.020
    期刊号:
    2019,50(06)
    收稿日期:
    修回日期:
    摘要:
    设计了一种基于混合布尔网络的混沌真随机数发生器,其熵源由18节点自治布尔网络构成,用于产生高幅值(3 V)、大带宽(780 MHz)的布尔混沌;利用同步布尔网络对布尔混沌进行采样、量化,最终实现了实时速率为100 Mbps的真随机数产生。同时完成了真随机数发生器的ASIC芯片设计,芯片采用中芯国际SMIC 0.35μm 3.3 V CMOS标准工艺,核心电路面积0.02 mm~2.利用Cadence Spectre仿真器,对芯片版图进行了后端仿真验证。仿真结果表明,该芯片可以在100 MHz时钟下输出满足随机性检测标准的真随机数序列。
    关键字:
    ASIC; 布尔混沌; 随机数发生器; 随机性测试; 自治布尔网络

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